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TMS320VC5402PGE100 数字信号处理器
TMS320VC5402PGE100 数字信号处理器
TMS320VC5402PGE100的说明
TMS320VC5402定点数字信号处理器(DSP)(除非另有说明，否则以下称为‘5402)基于先进的改进型Harvard架构，具有一条程序存储器总线和三条数据存储器总线。该处理器提供高度并行的算术逻辑单元(ALU)、专用硬件逻辑、片内存储器和额外的片内外设。这种DSP的操作灵活性和速度的基础是高度专业化的指令集。

独立的程序和数据空间允许同时访问程序指令和数据，提供了高度的并行性。可以在单个周期中执行两次读操作和一次写操作。具有并行存储和应用特定指令的
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TMS320VC5402PGE100的特性
●先进的多总线架构，具有三条独立的16位数据存储器总线和一条程序存储器总线
●40位算术逻辑单元(ALU)，包括一个40位桶形移位器和两个独立的40位累加器
●耦合到40位专用加法器的17×17位并行乘法器，用于非流水线单周期乘法/累加(MAC)操作
●维特比运算符的加法/比较选择的比较、选择和存储单元(CSSU)
●指数编码器，用于在单个周期中计算40位累加器值的指数值
●两个地址发生器，带有八个辅助寄存器和两个辅助寄存器运算单元(ARAUs)
●具有总线保持器特征的数据总线
●1M × 16位最大可寻址外部程序空间的扩展寻址模式
●4K x 16位片上ROM
●16K x 16位双通道片内RAM
●程序代码的单指令重复和块重复操作
●用于高效程序和数据管理的块内存移动指令
●具有32位长字操作数的指令
●双操作数或三操作数读取指令
●具有并行存储和并行加载的算术指令
●条件存储指令
●从中断快速返回
●片内外设
●软件可编程等待状态发生器和可编程存储体切换
●内置振荡器或外部时钟源的片内锁相环(PLL)时钟发生器
●两个多通道缓冲串行端口(McBSPs)
●增强型8位并行主机端口接口(HPI8)
●两个16位定时器
●六通道直接内存访问(DMA)控制器
●省电模式下IDLE1、IDLE2和IDLE3指令的功耗控制
●CLKOUT Off控制禁用CLKOUT
●基于片内扫描的仿真逻辑，IEEE标准1149.1 (JTAG)边界扫描逻辑
●3.3电源(1.8内核)的单周期定点指令执行时间为10 ns(100 MIPS)
●提供144引脚塑料薄型四方扁平封装(LQFP) (PGE后缀)和144引脚球栅阵列(BGA) (GGU后缀)
 
TMS320VC5402PGE100的说明
TMS320VC5402定点数字信号处理器(DSP)(除非另有说明，否则以下称为‘5402)基于先进的改进型Harvard架构，具有一条程序存储器总线和三条数据存储器总线。该处理器提供高度并行的算术逻辑单元(ALU)、专用硬件逻辑、片内存储器和额外的片内外设。这种DSP的操作灵活性和速度的基础是高度专业化的指令集。
 
独立的程序和数据空间允许同时访问程序指令和数据，提供了高度的并行性。可以在单个周期中执行两次读操作和一次写操作。具有并行存储和应用特定指令的指令可以充分利用这种架构。此外，数据可以在数据和程序空间之间传输。这种并行性支持一组强大的算术、逻辑和位操作操作，这些操作可以在一个机器周期内完成。此外，5402还包括管理中断、重复操作和函数调用的控制机制。
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