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SN74LS373N 具有三态输出的八路 D 类透明锁存器
SN74LS373N 具有三态输出的八路 D 类透明锁存器
74LS373N的说明
这些8位寄存器具有3态输出，专为驱动高容性或相对低阻抗负载而设计。高阻抗三态和增加的高逻辑电平驱动使这些寄存器能够直接连接并驱动总线组织系统中的总线，而无需接口或上拉元件。这些器件对于实现缓冲寄存器、I/O端口、双向总线驱动器和工作寄存器特别有吸引力。

LS373和S373的八个锁存器是透明D型锁存器，这意味着当使能(C或CLK)输入为高电平时，Q输出跟随数据(D)输入。当C或CLK被拉低时，输出被锁存在所设置的数据电平。

LS374和S374的八个触发器是边沿触发的
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74LS373N的特性
●单个封装中可选择八个锁存器或八个D型触发器
●三态总线驱动输出
●加载的完全并行访问
●缓冲控制输入
●时钟使能输入具有迟滞，以改善噪声抑制(' S373和' S374)
●P-N-P输入减少数据线上的DC负载(' S373和' S374)
 
74LS373N的说明
这些8位寄存器具有3态输出，专为驱动高容性或相对低阻抗负载而设计。高阻抗三态和增加的高逻辑电平驱动使这些寄存器能够直接连接并驱动总线组织系统中的总线，而无需接口或上拉元件。这些器件对于实现缓冲寄存器、I/O端口、双向总线驱动器和工作寄存器特别有吸引力。
 
LS373和S373的八个锁存器是透明D型锁存器，这意味着当使能(C或CLK)输入为高电平时，Q输出跟随数据(D)输入。当C或CLK被拉低时，输出被锁存在所设置的数据电平。
 
LS374和S374的八个触发器是边沿触发的D型触发器。在时钟正转换时，Q输出设置为D输入设置的逻辑状态。
 
由于输入迟滞，交流和直流噪声抑制通常提高400 mV，因此,' S373和' S374器件的使能/时钟线路上的施密特触发器缓冲输入简化了系统设计。缓冲输出控制(OC)输入可用于将8路输出置于正常逻辑状态(高或低逻辑电平)或高阻态。在高阻抗状态下，输出既不加载也不驱动总线线路。
 
OC\不影响锁存器或触发器的内部操作。也就是说，即使输出关闭，也可以保留旧数据或输入新数据。
 
电话:+86-755-83681378 83291586 83687442
传真:+86-755-83687442
移动电话:13424188068 
联系QQ：800007218
联系人:黄小姐、陈先生、陈小姐
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